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1、
2、
针对系统各部分工作频率的特点，采用公倍数时钟作为全局时钟进行同步设计的方法，解决了多速率系统信号输出的同步问题。
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3、
提出了一种光纤通道网络的单向延迟测试方法：全局时钟以太网同步测试法。
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4、
通过合理使用DCM（数字时钟管理单元）和BUFG-MUX（全局时钟选择缓冲器）等FPGA的特殊资源，手动搭建时钟电路，可以尽可能地减少时钟偏差对电路时序的影响。
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5、
使用驻波和耦合振荡器技术的全局时钟网可以显著的减少信号的偏斜和抖动。
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